崗位職責(zé)：1、負(fù)責(zé)芯片架構(gòu)設(shè)計(jì)，主要為功耗架構(gòu)設(shè)計(jì)；2、負(fù)責(zé)性能-功耗的聯(lián)合分析、評(píng)估、建模；3、負(fù)責(zé)性能-功耗的優(yōu)化策略制定，以及落地；4、與Power Integrity (電源完整性)、封裝、Post-Silicon團(tuán)隊(duì)合作，應(yīng)對(duì)設(shè)計(jì)挑戰(zhàn)。崗位要求：1、微電子/計(jì)算機(jī)科學(xué)碩士或博士，對(duì)于低功耗處理器架構(gòu)有設(shè)計(jì)經(jīng)驗(yàn)；2、10年以上power architecture/power analysis/power optimization經(jīng)驗(yàn)。

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